完整时钟解决方案

中心论题：

• 介绍时钟树解决方案
• 介绍PureEdge时钟产生模块，PLL技术的优势

解决方案：

• 采用高性能的可编程时钟乘法器
• 采用单个多PLL可编程时钟解决方案

安森美半导体（ON Semiconductor）不断开发和拓展完整的时钟解决方案，进一步巩固了其在时钟市场上的技术领导者地位。基于在双极型、CMOS和0.18μm硅锗（SiGe）BiCMOS工艺上先进的锁相环（PLL）电路布局和设计专业技术，安森美半导体25年来一直在最低抖动和skew时钟分配性能方面领先业界。安森美半导体的时间抖动比竞争对手小50%，令系统设计更简易，并消除时间误差。

安森美半导体的时钟树解决方案包括时钟产生和时钟支持及分配两大部分。前者包括高性能时钟、时钟模块、灵活的CMOS可编程时钟；后者包括时钟分配、分立式PLL器件、时钟支持逻辑。其中，时钟产生部分中基于PLL的PureEdge™硅频率模块NBXxxxx系列目前包括九款产品，均具有业界一流的长期时域抖动性能和10 MHz频率优异的-163 dBc/Hz元件域噪声，可弥补在整合12 Hz至20 MHz频率时的0.4皮秒(ps)均方根(RMS)相位抖动，使整个系统时钟树具有更大的时序裕量。这些元件创造了亚皮秒抖动质量的时钟，可以实现100 MHz、106.25 MHz、125 MHz、155.52 MHz、156.25 MHz、200.00 MHz、212.5 MHz、250 MHz、311.04 MHz和312.5 MHz中的单个和/或两个频率，非常适用于1x/2x光纤信道、串行ATA、iSCSI、PCIe、同步光网络(SONET)/同步数字体系(SDH)、以太网和时钟裕量应用。

采用PureEdge™时钟产生模块可以为设计师带来以下优势：替代传统晶振，降低成本，增加灵活性和功能。在晶振方面，可以缩短传统晶振的上市时间，易于获得非标准频率。更重要的是，混合模块中的PLL可以在5 mm×7 mm×1.9 mm陶瓷封装中直接替代晶振模块。这种方式可以提供多种可供选择的频率、多种逻辑系列输出电平(无需电平转换器)，抑制抖动；还可以降低制造成本，提高可靠性。

安森美半导体标准产品部先进逻辑分部总监兼总经理何焘(Dan Huettl)表示，PLL技术还具备许多其他传统晶振所没有的优势，包括设计上的灵活性、可编程能力，有助于降低成本和提高性能。可编程PLL还可以产生多种频率，支持多种接口，所以能以单一IC满足全部时钟树要求，让客户能以单个器件替代多个晶振，实现灵活的设计。此外，它还支持扩频和可编程延迟等新功能。

值得一提的是，除了高性能PureEdge™时钟产生模块为设计人员实现晶振替代和提升灵活性，安森美半导体的可编程时钟以单颗器件替代传统解决方案，为设计人员提供灵活性，并具有一流抖动性能，帮助他们满足设计要求。以常见的机顶盒(STB)、数字电视、家庭网关和其它消费应用等为例，这些系统中可能涉及到众多不同的功能模块，需要不同的时钟频率，如PCI(33 MHz)、PCIe(66 MHz)、USB(24/48 MHz)、以太网(20/25/50 MHz)、处理器时钟(14/24 MHz)、视频时钟(27 MHz)、ADSL/VDSL(36 MHz)、DDR2/DDR3存储器时钟(100/133/166/200/266/333/400 MHz)、千兆位以太网GbE(125 MHz)和ASIC时钟(厂商专有的30至100 MHz)等。目前业界用于满足机顶盒等应用复杂时钟要求的解决方案是分产晶体和/或CMOS晶体振荡器。这种解决方案带来许多问题，一是成本高昂，每部机顶盒/数字电视等系统需要采用5至7颗晶体/晶体振荡器，二是占用过多的电路板空间，三是增加了设计复杂度，四是晶体和CMOS晶体振荡器的采购交货周期较长，不利于制造商加快产品上市时间。针对这些问题，安森美半导体推出高性能的可编程时钟乘法器，采用单个多PLL可编程时钟解决方案替代机顶盒、数字电视和其它消费应用中的所有分立晶体和/或CMOS晶体振荡器，产生系统需要的所有频率，帮助减小电路板空间、降低成本及提高设计灵活性。

NB3N3020就是安森美半导体最新推出的一款可编程时钟乘法器，这器件在同颗器件上产生低压正射极耦合逻辑(LVPECL)时钟及低压互补金属氧化物半导体(LVCMOS)时钟，这使NB3N3020能够用于宽广范围的应用，如网络、消费电子和计算机应用。这器件含有三个三电平LVCMOS单端选择引脚，设定26种可能时钟频率中的一种，从而为设计人员提供灵活性，帮助他们满足设计要求，及采用单颗定制器件替代不同系统中的多个时钟。NB3N3020可编程时钟乘法器拥有8 MHz至210 MHz的宽输出频率范围。它采用一颗5.0至27 MHz基本模式并行谐振晶体或一颗2.0至210 MHZ LVCMOS单端时钟源，产生差分LVPECL输出和单端LVCMOS输出，而多种可供选择的时钟输出频率是对输入时钟频率相乘的结果。低电平时，LVCMOS输出启用(OE)三态时钟输出，使系统设计人员能够在其系统中动态地控制时序状况。这器件拥有极佳的抖动性能，周期抖动仅为5皮秒(ps)，从而为电路板设计人员提供更高的系统时序裕量，适合更高频率的设计，具有更高的可靠性。

除了不断推出新产品，安森美半导体也针对不同客户的不同需求进行产品定制化。安森美半导体的新一代产品策略是充分利用在专有组件库、高速PLL设计和微型封装的技术优势，继续开发领先业界的时钟产生和支持产品及逻辑转换器，以业界最完整、抖动最低的时钟树解决方案满足路由器/交换机、光网络/无源光网络(PON)、DSLAM/集成多工器、工作站CPU和存储器时钟分配、网络服务器、存储区域网络(主总线适配器卡、网络卡)、工作站和服务器、机顶盒和数字电视等应用的需求。